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Message-ID: <1614199.PesBpXyHut@dabox>
Date: Fri, 12 Feb 2016 09:28:01 +0100
From: Tim Sander <tim@...eglstein.org>
To: Sebastian Andrzej Siewior <bigeasy@...utronix.de>
Cc: linux-rt-users <linux-rt-users@...r.kernel.org>,
LKML <linux-kernel@...r.kernel.org>,
Thomas Gleixner <tglx@...utronix.de>, rostedt@...dmis.org,
John Kacur <jkacur@...hat.com>
Subject: Re: [ANNOUNCE] 4.1.5-rt5
Hi Sebastian
Am Sonntag, 16. August 2015, 15:56:30 schrieb Sebastian Andrzej Siewior:
> I'm pleased to announce the v4.1.5-rt5 patch set.
I have just tested it with a Altera SoC ARM v7. The latencies seem to have
gotten a little bit worse with each release. The first core has always been
worse (presumably due to interrupt load) but now it dropped to 111µs (rt5)
from 76µs(rt3) and 54µs(rt2).
As a sidenote the 4.4 rt series seems pretty stable for an early rt for me.
Best regards
Tim
This is with rt-5
cyclictest -l100000000 -m -Sp99 -i200 -h400 -q
# /dev/cpu_dma_latency set to 0us
# Histogram
000000 000000 000000
000001 000000 000000
000002 000000 000000
000003 000000 000000
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000015 218174 342917
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000017 1712477 3423727
000018 5462224 10317491
000019 12167685 18517716
000020 18019078 20310970
000021 18572032 15346425
000022 14356203 9325624
000023 9254028 5507225
000024 5685996 3572617
000025 3759456 2542168
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000027 1934875 1422472
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000031 429086 586878
000032 298248 417162
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# Histogram Overflow at cycle number:
# Thread 0:
# Thread 1:
sander@...ox:~/work/cp52-firmware$ cat 4.4-rt2_latency_10000000_hackbench.txt
#cyclictest -l1000000000 -m -Sp99 -i200 -h400 -q
# /dev/cpu_dma_latency set to 0us
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